【Verilog】記述言語で論理設計 Project5【VHDL】at DENKI【Verilog】記述言語で論理設計 Project5【VHDL】 - 暇つぶし2ch1: ◆YMO/ALTERA 07/03/20 00:59:24 JXobcCSAHDLの処理系も、それを実際に動かすシミュレータ・評価基板も 安価で入手できるようになってきました。 このスレが目に入ったおまえ! HDLで何か作って遊んでみませんか。 日曜工作のHDL書き、学生さん、プロの方、カキコお待ちしております。 関連情報は >>2-10 あたり。 前スレ 【Verilog】記述言語で論理設計 Project4【VHDL】 スレリンク(denki板)l50 レスを読む最新レス表示レスジャンプ類似スレ一覧スレッドの検索話題のニュースおまかせリストオプションしおりを挟むスレッドに書込スレッドの一覧暇つぶし2ch